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賽思時鐘發生器芯片廠家時鐘發生器芯片廠家時鐘芯片是一種基于PLL的時鐘發生器，采用ADPLL（全數字鎖相環）技術，以實現的高頻低相噪性能，并具備低功耗和高PSNR能力，可實現小于0.3ps RMS的相位抖動性能。

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更新日期
2025-09-02

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賽思10路單端國產時鐘芯片 10路單端國產時鐘芯片$n是一款高性能、低噪聲的LVCMOS房出緩沖器，此緩沖器可以從單端、差分或晶體輸入中分配出10路超低抖動時鐘。

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更新日期
2025-09-02

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賽思時鐘緩沖器芯片 10路差分buffer 時鐘緩沖器芯片 10路差分buffer是一款3GHz、10路差分扇出緩沖器，用于高頻、低抖動時鐘/數據分配和電平轉換。可從兩個差分輸入或一個晶體輸入中選擇輸入時鐘。所選擇的輸入時鐘被分配到兩組輸出，每組輸出包含5個差分輸出，另外還有1個帶Sync同步功能的LVCMOS 輸出。

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更新日期
2025-09-02

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賽思國產同步時鐘芯片國產同步時鐘芯片高精度時鐘芯片是一種基于PLL的時鐘發生器，采用ADPLL（全數字鎖相環）技術，以實現的高頻低相噪性能，并具備低功耗和高PSNR能力，可實現小于0.3ps RMS的相位抖動性能。$n可輸出差分100MHz，125MHz，156.25MHz和單端33.33MHz CPU時鐘，同時輸出6路25MHz緩沖參考時鐘。

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更新日期
2025-10-21

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賽思國產高精度時鐘芯片國產高精度時鐘芯片是一款高性能的時頻同步SOC芯片，可以用于電信、交通、金融證券等領域。該芯片的功能可以靈活配置，既能夠輸出高精度時間同步信號，又可以輸出各種頻點的高性能時鐘，該芯片可以提供面向GPS/北斗授時，IEE1588和同步以太網時鐘解決方案。產品內部集成多片高性能鎖相環芯片，具有強大的頻率合成、抖動濾除、超低時延、高精度相位調整等功能。

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更新日期
2025-09-02

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賽思低抖動時鐘發生器低抖動時鐘發生器是一款基于PLL的、適用于5G基站應用的時鐘發生器。采用數字鎖相環技術，以實現更好的高頻低相噪性能，具有低功耗和高PSRR能力。采用ADPLL技術，管腳兼容843N571，可以實現＜0.3ps RMS的相位抖動性能。

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更新日期
2025-09-02

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